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always @(イベント式) begin 〜 end

always @(negedge clr or negedge pr

      or posedge clk ) begin

 case ({clr,pr})

 endcase

end

endmodule

clr

pr

q

0

1

0

1

0

1

1

1

D-FFとして動作

0

0

X (禁止入力)

出力Qは保証しない

if文でもよい