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図
次回以降の予定
Verilog HDL基礎
組合せ論理回路をVerilog HDLで扱う
論理回路(3SJ)で扱った組合せ論理回路
多数決回路
比較器
一致入力回路 不一致入力回路 nビット比較回路
マルチプレクサ デマルチプレクサ
符号変換(エンコーダ デコーダ)
nビット全加算器 nビット加減算器
論理回路で使用した 印刷教材があると いいかも?