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図
基本論理ゲート(andゲート)を記述する
[作成するファイル]
00.v
論理回路(andゲート)を記述
testbench00.v
論理回路記述をシミュレートする条件
入力信号はどのようなタイミングで0,1になるか
何を表示させるか
等